1樓:萬寶全書缺壹頁
一般情況下建議:
1、與門空腳接高電平
2、或門空腳接低電平
不建議懸空,會傳入干擾
2樓:匿名使用者
多餘 的閘電路的輸入端,接地或者vcc,一般都是接地,如果內部有上拉或者下拉,可以忽略
3樓:匿名使用者
d. 因為根據與非門的真值表,只要有一個輸入端為低電平,輸出即為低電平,從而直接影響輸出結果。而接高電平不會,其輸出結果至於敏感的輸入有關。
cmos與非門多餘輸入端的處理方法為 () a懸空 b接高電位 c接地
cmos 整合邏輯閘的多餘輸入端如何處理?
4樓:
1、cmos 整合邏輯閘的多餘輸入端必須接到固定電壓上(高,低電平都可以),不允許懸空。
2、懸空的cmos輸入端將會由於干擾而產生功耗的大幅上升。並影響正常使用邏輯閘電路的工作。
***s閘電路的多餘輸入端一般如何處理
5樓:陳堅道
對於多餘的輸入端頭要根據電路的功能分別處置。
與門和與非門:多餘端應接高電平。
或門和或非門:多餘端應接低電平。
如果電路的工作速度不高,功耗也不需要特別考慮的,也可將多餘端與使用端並接。
6樓:匿名使用者
與門和與非門:多餘端應接高電平。
或門和或非門:多餘端應接低電平。
對cmos與非閘電路,其多餘輸入端正確的處理方法是( )。
7樓:微微三千
d. 因為根據與非門的真值表,只要有一個輸入端為低電平,輸出即為低電平,從而直接影響輸出結果。而接高電平不會,其輸出結果至於敏感的輸入有關。
8樓:
d若接地或懸空會使輸出始終為1。
對cmos與非閘電路,其多餘輸入端正確的處理方?????
9樓:
多餘輸入端通過上拉電阻接閘電路正電源,相當於輸入高電平。
10樓:匿名使用者
或者接地或者上拉電阻接高電平,反正懸空是不行的
ttl門和cmos門懸空引腳如何處理?
11樓:哇哎西西
ttl門的輸入引腳可以懸空
,懸空狀態的輸入相當於高電平輸入。cmos輸入引腳不能懸空,內應接高電平或0。
ttl和***s電路比較容:
1、ttl電路是電流控制器件,而***s電路是電壓控制器件。
2、ttl電路的速度快,傳輸延遲時間短(5-10ns),但是功耗大。
3、***s電路的速度慢,傳輸延遲時間長(25-50ns),但功耗低。
4、***s電路的供電電壓高於ttl電路,也就是可以工作在較寬的電壓範圍之內。
12樓:匿名使用者
ttl閘電路一般bai由晶體三極體電路構du成。對於ttl電路多
zhi餘輸入端dao的處理,應採用以下方法回
:ttl與門和與非門電答路:
將多餘輸入端接高電平,即通過限流電阻與電源相連線;
根據ttl閘電路的輸入特性可知,當外接電阻為大電阻時,其輸入電壓為高電平,這樣可以把多餘的輸入端懸空,此時輸入端相當於外接高電平;
通過大電阻(大於1kω)到地,這也相當於輸入端外接高電平;
當ttl閘電路的工作速度不高,訊號源驅動能力較強,多餘輸入端也可與使用的輸入端並聯使用。
ttl或門、或非門:
接低電平;
接地;由ttl輸入端的輸入伏安特性可知,當輸入端接小於ikω的電阻時輸入端的電壓很小,相當於接低電平,所以可以通過接小於ikω(500ω)的電阻到地。
cmos 閘電路一般是由mos管構成,在使用cmos閘電路時輸入端特別注意不能懸空
與門和與非閘電路:多餘輸入端應採用高電平,即可通過限流電阻(500ω)接電源。
或門、或非閘電路:多餘輸入端的處理方法應是將多餘輸入端接低電平,即通過限流電阻(500ω)接地。
13樓:匿名使用者
ttl門的輸入引腳可以懸空,懸空輸入是高電平.cmos輸入不用的引腳應接高電平或0.兩種電路的沒用的輸出,懸空.
cmos和ttl整合閘電路多餘輸入端怎麼處理
14樓:響亮創新者
cmos和ttl整合閘電路多餘輸抄入端的襲處理應該以不影響電路正常工作為原則。
ttl整合閘電路大都應該接高電平(極少數接地,如與或非門)。
cmos整合閘電路,與門、與非門應該接高電平;或門和或非門應該接地電平。
滿意請採納。
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