verilog語言埠分為哪幾種

2021-03-03 23:58:42 字數 692 閱讀 6990

1樓:宋桓公

input 輸入埠;

output 輸出埠;

inout 輸入輸出埠;

望採納,歡迎追問~~~

2樓:林莫語

輸入也就是input

輸出output

這兩個都差不多很好理解

還有就是inout,這種大概有兩種,但是就硬體上來說,其實都是一種,但是在某些情況下會把這個分為雙向以及三態這兩種

3樓:潔之殤殤

input

output

inout

具體怎麼用 看幾個module就可以了

有關verilog語言模組中埠資料型別問題,菜鳥求解。

4樓:匿名使用者

一般都是input output 或inout 3種

在modelsim**時才用reg wire作為輸入輸出埠

因為**並沒有真正的介面,只是虛擬的,不能用input output

5樓:匿名使用者

輸入埠既可以是線網,也可以是暫存器。

輸出埠必須是線網,不能是暫存器。

雙向io既可以當輸入,也可以當輸出,但一般只在最頂層(最外層)模組使用雙向io。

個人觀點,僅供參考。

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