1樓：津人依夢趣談體育
ttl三態輸出門可以實現「線與」。因為ttl三態輸出門在電路中增加了一個輸出控制端，當此控制端=1時，對原電路無影響，電路的輸出符合原來電路的所有邏輯關係。反之，電路內部所有的輸出將處於一種關斷狀態。
「線與」指的是，兩個或兩個以上的輸出端直接相連，實現邏輯「與」的功能。在硬體上能實現此功能的除了ttl三態輸出門，還有集電極開路門（oc門）。
一般的ttl門不能實現此功能，在輸出管間低阻抗形成很大的短路電流，容易燒壞器件。
擴充套件資料
ttl電路的發展：
ttl電路採用雙極型工藝製造，具有高速度和品種多等特點。 從六十年代開發成功第一代產品以來現有以下幾代產品。
1）第一代ttl包括sn54/74系列，（其中54系列工作溫度為-55℃～+125℃，74系列工作溫度為0℃～+75℃) ，低功耗系列簡稱lttl，高速系列簡稱httl。
2）第二代ttl包括肖特基箝位系列（sttl)和低功耗肖特基系列（lsttl）。
3）第三代為採用等平面工藝製造的先進的sttl(asttl)和先進的低功耗sttl（alsttl）。由於lsttl和alsttl的電路延時功耗積較小，sttl和asttl速度很快，因此獲得了廣泛的應用。
2樓：做而論道
只有「oc」門可以實現「線與」。
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為什麼，其實很簡單。
但是在網上講，就很難確定要從什麼基礎開始講起。
弄不好，要講很長，才能使得樓主滿意。
還是看書，比較全面。
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oc門由於內部結構的原因，不能輸出高電平，只能輸出低電平。
所以可以把它們的輸出端直接連線，外接同一個上拉電阻。
當它們之中有一個輸出低電平的時候，總的輸出就是低電平；
當它們之中全都是輸出高電平的時候，總的輸出就是高電平；
這就是「線與」。
三態門既能輸出高電平，也能輸出低電平。
如果把它們的輸出端直接連線，就可能造成「短路」現象；
輕則會使總輸出變成「非0非1的邏輯混亂」，重則會燒燬某個引腳的內部電路。
ttl電路中輸出端可實現線與功能的電路是什麼
3樓：匿名使用者
ttl電路中輸出端可實現線與功能的電路是」oc門「。
oc門，又稱集電極開路門，open collector。
線與邏輯，即兩個輸出端（包括兩個以上）直接互連就可以實現「and」的邏輯功能。在匯流排傳輸等實際應用中需要多個門的輸出端並聯連線使用，而一般ttl門輸出端並不能直接並接使用，否則這些門的輸出管之間由於低阻抗形成很大的短路電流（灌電流），而燒壞器件。在硬體上，可用oc門或三態門（st門）來實現。
用oc門實現線與，應同時在輸出埠應加一個上拉電阻。
ttl電路是電晶體-電晶體邏輯電路的英文縮寫（transister-transister-logic ），是數字積體電路的一大門類。它採用雙極型工藝製造，具有高速度低功耗和品種多等特點。ttl電路採用雙極型工藝製造，具有高速度和品種多等特點。
4樓：匿名使用者
9、什麼叫做圖騰柱，它與開漏電路有什麼區別？ ttl積體電路中，輸出有接上2、線與邏輯，即兩個輸出端（包括兩個以上）直接互連就可以實現「and」的
是否可以將ttl與非門的輸出端直接連起來實現邏輯線與，為什麼？高手賜教！
5樓：匿名使用者
不能的 有兩點吧，來如果把2個ttl直接接在一
自起，假如一bai個為高電平，一個為低du電平，你想下直接zhi接在一起會出現dao什麼情況呢？一定就是高電平被拉低削弱為無效電平或低電平，而低電平也會被拉高變為無效電平，這樣就造成了邏輯的混亂。二是當多個ttl直接相與時，當一個為低電平，其他為高電平時，就會有很大的電路灌入低電平那端，嚴重時燒燬管子。
為什麼一般的ttl與非門不能用來實現線與,而oc門可以實現線與？
6樓：匿名使用者
由於ttl閘電路的輸出端(不只是與非門)是圖騰柱結構，當多個輸出端連線到一專起，就會通過閘電路輸出屬端造成vcc對gnd短路燒壞閘電路。而oc門是需要上拉電阻接到vcc上才能得到高電平，所以不存在輸出端短路問題。
ttl閘電路為什麼輸出端不允許並聯相接
7樓：純情奇緣
除三態門、集覆電極開路門外，ttl整合制電路的 輸出端不允bai許並聯使用du，如果將zhi幾個集電極開路閘電路dao
的輸出端並聯，實現「線與」功能時，應在輸出端 與電源之間接人上拉電阻。
多餘的輸出端應該懸空處理，決不允許直接接到vdd或vss，否則會產生過大的短路電流而使器件 損壞 。不同邏輯功能的cm0s電路的輸出端也不能直接連到一起，否則導通的p溝道mos場效電晶體和導通的n溝道 mos場效電晶體形成低阻通路，造成電源短路而引起器件損壞。
擴充套件資料
ttl電平訊號:
1、ttl電平訊號被利用的最多是因為通常資料表示採用二進位制規定，+5v等價於邏輯「1」，0v等價於邏輯「0」，這被稱做ttl（電晶體-電晶體邏輯電平）訊號系統，這是計算機處理器控制的裝置內部各部分之間通訊的標準技術。
2、、計算機處理器控制的裝置內部的資料傳輸對於電源的要求不高以及熱損耗也較低，另外ttl電平訊號直接與積體電路連線而不需要**昂貴的線路驅動器以及接收器電路。
3計算機處理器控制的裝置內部的資料傳輸是在高速下進行的，而ttl介面的操作恰能滿足這個要求。
8樓：黑豹
如：a輸出高電平，上管導通，下管截止；b輸出低電平，上管截止，下管導
回通；a、b並聯，a輸出三極體
答的發射極直接被b輸出的下管接地，雖說有4k電阻限流，管子不至於立即燒燬，可是輸出的邏輯電平已經不對了，是高電平還是低電平？一般是不穩定的中間電平，即不會≤0.8v，也不會≥3.3v。
9樓：匿名使用者
不管bai是ttl 還是cmos，輸出
都不能直接連在一起du，zhi當一個dao輸出高電平，另一個輸出低電平，就會損壞輸版出權電路。一般只允許輸出接輸入，因為輸入的阻抗很高，不會損壞輸出電路。輸出允許並接的情況只允許在集電極開路或者漏極開路輸出的電路中
10樓：匿名使用者
一個高一個低並聯，，結果到底是高還是低？
並且容易燒燬輸出級
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